HBM4的推出，逻辑芯片的制造工艺已领受5纳米或更小的先进工艺，裁减了PNM本领的实施门槛。

跟着HBM4行将量产，存储器半导体行业正全力参加下一代本领“HBM-PNM”的预计。此举备受热心，被视为为以“可计议存储器”为中心的新期间作念准备，该期间径直在存储器里面处置计议，突破了以显卡(GPU)为中心的架构的死心。

据业内东说念主士11日裸露，由三星电子、英伟达、加州大学圣地亚哥分校、哥伦比亚大学和延世大学构成的勾通预计团队最近在arXiv上发表了一篇对于AMMA（多芯片内存中心架构）本领的论文，展示了HBM-PNM本领的可行性。

PNM（近内存处置）本领通过将荒芜的计议单位摒弃在HBM堆栈的逻辑芯片上，径直在内存附近扩充计议。现存的PIM（内存内处置）花样将计议电路摒弃在存储单位里面，而PNM的上风在于大约在保执内存容量的同期，已毕更复杂、更巨大的计议。

当今，大型话语模子（LLM）做事的最大瓶颈在于解码阶段的细心力机制。在对长陡立文进行解码细心力时，GPU跳动95%的计议能力处于闲置景象，导致内存带宽险些被弥散运用。

即使是Rubin GPU，分析也炫耀，其计议中枢（占封装面积的67%，功耗的73%）在万古刻运转的情况下内容运用率仅为4%至5%附近。这变成了资源奢侈，亦然导致功耗加多和发烧问题的主要原因。

跟着HBM4的推出，逻辑芯片的制造工艺已领受5纳米或更小的先进工艺，裁减了PNM本领的实施门槛。该预计团队提议的AMMA决策移除了现存GPU的计议芯片，并将16个HBM-PNM立方体以4×4网格结构一语气起来。这使得封装内的内存带宽栽植至44TB/s，约为现存架构的两倍。

在内容预计中，与NVIDIA H100比较，AMMA架构将细心力延伸裁减了15.5倍，能耗裁减了6.9倍。其速率也比下一代Rubin GPU快1.8到2.5倍，能效提高了2.6到3.1倍。尤其值得一提的是，它在处置百万级（1M Context）的超长陡立文推理和智能体使命负载方面发达出色。

预计团队示意：“通过这项预计，咱们旨在解说以内存为中心的架构有后劲成为GPU以外的新式架构，并促进对下一代系统的预计，在这些系统中，K体育(中国)官网入口以内存为中心的加快器在异构平台中阐扬着要津作用。”

在摩尔定律的发展的几十年里，处置器、存储器等组件束缚发展，处置器算力、存储器存储量王人得到了大幅栽植。但与之而来的，即是“存储墙”、“带宽墙”、“功耗墙”等问题。由于处置器的峰值算力每两年增长3.1倍，而动态存储器的带宽每两年增长1.4倍，存储器的发展速率远过期于处置器，进出1.7倍。CPU时钟速率与片外内存和磁盘驱动器I/O速率之间的差距越来越大。比如，动态立地存储器DRAM（Dynamic Random Access Memory）是芯片领域“最巨额单一居品”，精密工业制造的王冠之一，被喻为一语气中央处置器（CPU）的“数据高速公路”。其功能是暂存正在运转的多样次第和数据，是一种易失性存储器，即断电后数据就丢失。DRAM由于其较差的可膨大性和极高的打算资本明锐性（每比特资本），其发展相对较慢，在10nm本领节点就碰到了天花板。

存储墙导致访存时延高，后果低，存储器的数据走访速率跟不上处置器的数据处置速率，存算性能失配。为了冲破存储墙，一经提议了无数的预计使命来优化DRAM架构，上文提到的近存计议即是一种，此外还有存内计议等路线。

存内计议是在内存中完成部分计议，在处置器中完成部分计议。相较于内存计议将计议所需的所稀有据放入到内存中，统统计议由处置器完成，存内计议裁减了数据在内存与高速缓存，高速缓存与CPU之间挪动的能耗，提高内存计议系统的性能。其中枢上风在于高算力、低功耗、低延伸，主要分为端侧（小算力低功耗）、边侧（中算力及时处置）和云侧（高算力）。典型应用领域包括：终局及物联网(IoT)场景、边际计议及AI估量场景以及云表/大规模计议场景。

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